e203_7010.xpr

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<!-- Product Version: Vivado v2019.2 (64-bit)              -->
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  <DefaultLaunch Dir="$PRUNDIR"/>
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  <FileSets Version="1" Minor="31">
    <FileSet Name="sources_1" Type="DesignSrcs" RelSrcDir="$PSRCDIR/sources_1">
      <Filter Type="Srcs"/>
      <File Path="$PSRCDIR/sources_1/imports/apb_i2c/i2c_master_defines.v">
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      </File>
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        <FileInfo>
          <Attr Name="IsGlobalInclude" Val="1"/>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/core/config.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/bd/reset_sys/reset_sys.bd">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/bd/ip_mmcm/ip_mmcm.bd">
        <FileInfo>
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        </FileInfo>
        <CompFileExtendedInfo CompFileName="ip_mmcm.bd" FileRelPathName="ip/ip_mmcm_clk_wiz_0_1/ip_mmcm_clk_wiz_0_1.xci">
          <Proxy FileSetName="ip_mmcm_clk_wiz_0_1"/>
        </CompFileExtendedInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_adv_timer/adv_timer_apb_if.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_adv_timer/adv_timer_apb_if.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_adv_timer/apb_adv_timer.v">
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          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_adv_timer/apb_adv_timer.v"/>
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        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_uart/apb_uart.v">
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        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_exu_csr.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/core/e203_exu_csr.v"/>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_exu_decode.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/core/e203_exu_decode.v"/>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_exu_disp.v">
        <FileInfo>
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        <FileInfo>
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        <FileInfo>
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        <FileInfo>
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      </File>
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        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_ifu.v">
        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_ifu_ifetch.v">
        <FileInfo>
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        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_ifu_litebpu.v">
        <FileInfo>
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        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_itcm_ctrl.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/core/e203_itcm_ctrl.v"/>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_lsu_ctrl.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_reset_ctrl.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/soc/e203_soc_top.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/core/e203_srams.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_clint.v">
        <FileInfo>
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        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_hclkgen.v">
        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_hclkgen_rstsync.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/subsys/e203_subsys_hclkgen_rstsync.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_main.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/subsys/e203_subsys_main.v"/>
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      </File>
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        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/subsys/e203_subsys_mems.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_nice_core.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/subsys/e203_subsys_nice_core.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_perips.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/subsys/e203_subsys_perips.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_plic.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/subsys/e203_subsys_plic.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_pll.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/subsys/e203_subsys_pll.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_pllclkdiv.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/subsys/e203_subsys_pllclkdiv.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/subsys/e203_subsys_top.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/subsys/e203_subsys_top.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_i2c/i2c_master_bit_ctrl.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_i2c/i2c_master_bit_ctrl.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_i2c/i2c_master_byte_ctrl.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_i2c/i2c_master_byte_ctrl.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_adv_timer/input_stage.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_adv_timer/input_stage.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_uart/io_generic_fifo.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_uart/io_generic_fifo.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
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          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_adv_timer/prescaler.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_adv_timer/prescaler.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/general/sirv_1cyc_sram_ctrl.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/general/sirv_1cyc_sram_ctrl.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_AsyncResetReg.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_AsyncResetReg.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_AsyncResetRegVec.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_AsyncResetRegVec.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_AsyncResetRegVec_1.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_AsyncResetRegVec_1.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_AsyncResetRegVec_129.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_AsyncResetRegVec_129.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_AsyncResetRegVec_36.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_AsyncResetRegVec_36.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_DeglitchShiftRegister.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_DeglitchShiftRegister.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_LevelGateway.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_LevelGateway.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_ResetCatchAndSync.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_ResetCatchAndSync.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_ResetCatchAndSync_2.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_ResetCatchAndSync_2.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_aon.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_aon.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_aon_lclkgen_regs.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_aon_lclkgen_regs.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_aon_porrst.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_aon_porrst.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_aon_top.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_aon_top.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_aon_wrapper.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_aon_wrapper.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_clint.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_clint.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_clint_top.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_clint_top.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/debug/sirv_debug_csr.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/debug/sirv_debug_csr.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/debug/sirv_debug_module.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/debug/sirv_debug_module.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
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          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/debug/sirv_debug_ram.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/debug/sirv_debug_ram.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/debug/sirv_debug_rom.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/debug/sirv_debug_rom.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_expl_axi_slv.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_expl_axi_slv.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_flash_qspi.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_flash_qspi.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_flash_qspi_top.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_flash_qspi_top.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/general/sirv_gnrl_bufs.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/general/sirv_gnrl_bufs.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/general/sirv_gnrl_dffs.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/general/sirv_gnrl_dffs.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/general/sirv_gnrl_icbs.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/general/sirv_gnrl_icbs.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/general/sirv_gnrl_ram.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/general/sirv_gnrl_ram.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_hclkgen_regs.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_hclkgen_regs.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/fab/sirv_icb1to16_bus.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/fab/sirv_icb1to16_bus.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/fab/sirv_icb1to2_bus.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/fab/sirv_icb1to2_bus.v"/>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/fab/sirv_icb1to8_bus.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/fab/sirv_icb1to8_bus.v"/>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/debug/sirv_jtag_dtm.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_jtaggpioport.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/mems/sirv_mrom.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/mems/sirv_mrom_top.v">
        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_plic_man.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_plic_man.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_plic_top.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_plic_top.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_pmu.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_pmu.v"/>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_pmu_core.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_pmu_core.v"/>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_qspi_arbiter.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_qspi_arbiter.v"/>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_qspi_fifo.v">
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_qspi_media.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_qspi_media.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_qspi_physical.v">
        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_queue.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_queue.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_queue_1.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_repeater_6.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_rtc.v">
        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/general/sirv_sim_ram.v">
        <FileInfo>
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      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_spi_flashmap.v">
        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/general/sirv_sram_icb_ctrl.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/general/sirv_sram_icb_ctrl.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_tl_repeater_5.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_tl_repeater_5.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_tlfragmenter_qspi_1.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_tlfragmenter_qspi_1.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_tlwidthwidget_qspi.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_tlwidthwidget_qspi.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/sirv_wdog.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/sirv_wdog.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_spi_master/spi_master_apb_if.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_spi_master/spi_master_apb_if.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_spi_master/spi_master_clkgen.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_spi_master/spi_master_clkgen.v"/>
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          <Attr Name="UsedIn" Val="implementation"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_spi_master/spi_master_controller.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_spi_master/spi_master_controller.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_spi_master/spi_master_fifo.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_spi_master/spi_master_fifo.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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          <Attr Name="UsedIn" Val="implementation"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_spi_master/spi_master_rx.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_spi_master/spi_master_rx.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_spi_master/spi_master_tx.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_spi_master/spi_master_tx.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_adv_timer/timer_cntrl.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_adv_timer/timer_cntrl.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_adv_timer/timer_module.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_adv_timer/timer_module.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
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          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_uart/uart_interrupt.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_uart/uart_interrupt.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_uart/uart_rx.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_uart/uart_rx.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_uart/uart_tx.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_uart/uart_tx.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
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          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/install/rtl/perips/apb_adv_timer/up_down_counter.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_adv_timer/up_down_counter.v"/>
          <Attr Name="ImportTime" Val="1673945656"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/fpga/zynq7010_e203/src/system.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/zynq7010_e203/src/system.v"/>
          <Attr Name="ImportTime" Val="1674961834"/>
          <Attr Name="UsedIn" Val="synthesis"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/core/e203_defines.v">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/core/e203_defines.v"/>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/hdl/ip_mmcm_wrapper.v">
        <FileInfo>
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        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
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      <File Path="$PSRCDIR/sources_1/imports/hdl/reset_sys_wrapper.v">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
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          <Attr Name="ImportTime" Val="1674971479"/>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="DesignMode" Val="RTL"/>
        <Option Name="TopModule" Val="system"/>
        <Option Name="TopAutoSet" Val="TRUE"/>
        <Option Name="VerilogDir" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/core"/>
        <Option Name="VerilogDir" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips/apb_i2c"/>
        <Option Name="VerilogDir" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl"/>
        <Option Name="VerilogDir" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/install/rtl/perips"/>
      </Config>
    </FileSet>
    <FileSet Name="constrs_1" Type="Constrs" RelSrcDir="$PSRCDIR/constrs_1">
      <Filter Type="Constrs"/>
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          <Attr Name="ImportPath" Val="D:/home/qaq/e203/e203_hbirdv2/fpga/zynq7010_e203/constrs/nuclei-config.xdc"/>
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      <Config>
        <Option Name="ConstrsType" Val="XDC"/>
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    <FileSet Name="sim_1" Type="SimulationSrcs" RelSrcDir="$PSRCDIR/sim_1">
      <Filter Type="Srcs"/>
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      </File>
      <Config>
        <Option Name="DesignMode" Val="RTL"/>
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        <Option Name="TopLib" Val="xil_defaultlib"/>
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        <Option Name="SrcSet" Val="sources_1"/>
      </Config>
    </FileSet>
    <FileSet Name="utils_1" Type="Utils" RelSrcDir="$PSRCDIR/utils_1">
      <Filter Type="Utils"/>
      <Config>
        <Option Name="TopAutoSet" Val="TRUE"/>
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    </FileSet>
    <FileSet Name="ip_mmcm_clk_wiz_0_1" Type="BlockSrcs" RelSrcDir="$PSRCDIR/ip_mmcm_clk_wiz_0_1">
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      </Config>
    </FileSet>
  </FileSets>
  <Simulators>
    <Simulator Name="XSim">
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      <Option Name="CompiledLib" Val="0"/>
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      <Option Name="Description" Val="ModelSim Simulator"/>
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      <Option Name="Description" Val="Questa Advanced Simulator"/>
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    </Simulator>
  </Simulators>
  <Runs Version="1" Minor="11">
    <Run Id="synth_1" Type="Ft3:Synth" SrcSet="sources_1" Part="xc7z010clg400-1" ConstrsSet="constrs_1" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" State="current" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Synthesis Defaults" Flow="Vivado Synthesis 2018"/>
        <Step Id="synth_design"/>
      </Strategy>
      <ReportStrategy Name="Vivado Synthesis Default Reports" Flow="Vivado Synthesis 2018"/>
      <Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
      <RQSFiles/>
    </Run>
    <Run Id="ip_mmcm_clk_wiz_0_1_synth_1" Type="Ft3:Synth" SrcSet="ip_mmcm_clk_wiz_0_1" Part="xc7z010clg400-1" ConstrsSet="ip_mmcm_clk_wiz_0_1" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/ip_mmcm_clk_wiz_0_1_synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Synthesis Defaults" Flow="Vivado Synthesis 2019">
          <Desc>Vivado Synthesis Defaults</Desc>
        </StratHandle>
        <Step Id="synth_design"/>
      </Strategy>
      <GeneratedRun Dir="$PRUNDIR" File="gen_run.xml"/>
      <ReportStrategy Name="Vivado Synthesis Default Reports" Flow="Vivado Synthesis 2019"/>
      <Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
      <RQSFiles/>
    </Run>
    <Run Id="impl_1" Type="Ft2:EntireDesign" Part="xc7z010clg400-1" ConstrsSet="constrs_1" Description="Default settings for Implementation." AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" State="current" SynthRun="synth_1" IncludeInArchive="true" GenFullBitstream="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Implementation Defaults" Flow="Vivado Implementation 2018"/>
        <Step Id="init_design"/>
        <Step Id="opt_design"/>
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        <Step Id="post_route_phys_opt_design"/>
        <Step Id="write_bitstream"/>
      </Strategy>
      <ReportStrategy Name="Vivado Implementation Default Reports" Flow="Vivado Implementation 2018"/>
      <Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
      <RQSFiles/>
    </Run>
    <Run Id="ip_mmcm_clk_wiz_0_1_impl_1" Type="Ft2:EntireDesign" Part="xc7z010clg400-1" ConstrsSet="ip_mmcm_clk_wiz_0_1" Description="Default settings for Implementation." AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" SynthRun="ip_mmcm_clk_wiz_0_1_synth_1" IncludeInArchive="false" GenFullBitstream="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Implementation Defaults" Flow="Vivado Implementation 2019">
          <Desc>Default settings for Implementation.</Desc>
        </StratHandle>
        <Step Id="init_design"/>
        <Step Id="opt_design"/>
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        <Step Id="write_bitstream"/>
      </Strategy>
      <ReportStrategy Name="Vivado Implementation Default Reports" Flow="Vivado Implementation 2019"/>
      <Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
      <RQSFiles/>
    </Run>
  </Runs>
  <Board/>
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